كلما زادت طلبات التقديم التي ترسلينها، زادت فرصك في الحصول على وظيفة!

إليك لمحة عن معدل نشاط الباحثات عن عمل خلال الشهر الماضي:

عدد الفرص التي تم تصفحها

عدد الطلبات التي تم تقديمها

استمري في التصفح والتقديم لزيادة فرصك في الحصول على وظيفة!

هل تبحثين عن جهات توظيف لها سجل مثبت في دعم وتمكين النساء؟

اضغطي هنا لاكتشاف الفرص المتاحة الآن!
نُقدّر رأيكِ

ندعوكِ للمشاركة في استطلاع مصمّم لمساعدة الباحثين على فهم أفضل الطرق لربط الباحثات عن عمل بالوظائف التي يبحثن عنها.

هل ترغبين في المشاركة؟

في حال تم اختياركِ، سنتواصل معكِ عبر البريد الإلكتروني لتزويدكِ بالتفاصيل والتعليمات الخاصة بالمشاركة.

ستحصلين على مبلغ 7 دولارات مقابل إجابتك على الاستطلاع.


تم إلغاء حظر المستخدم بنجاح
https://bayt.page.link/US1GRCPy6AygZz928
العودة إلى نتائج البحث‎

Principle Engineer - SoC Design Verification

قبل 30+ يومًا 2026/07/09
خدمات الدعم التجاري الأخرى
أنشئ تنبيهًا وظيفيًا لوظائف مشابهة
تم إيقاف هذا التنبيه الوظيفي. لن تصلك إشعارات لهذا البحث بعد الآن.

الوصف الوظيفي

Job Title: Principal DV Engineer


Location: [Pune, India ]


Role Overview:


We are seeking a highly experienced Design Verification (DV) engineer with 10+ years of expertise to lead verification strategy and execution for complex SoCs. The ideal candidate will have deep knowledge of ARM-based microcontrollers, low-power design verification, and experience with multiple interfaces and security IPs. This is a hands-on role requiring strong technical skills, leadership, and collaboration in a fast-paced environment.


Key Responsibilities:


  • Define and own SoC-level and IP-level verification strategy, methodology, and coverage goals.
  • Hands-on work:
  • Responsible for executing verification plan according to the product specification and verification requirements defined by product architects.
  • Responsible for developing, debugging and running UVM based verification environment for RTL/netlist simulation.
  • Define and develop test cases in an appropriate verification framework. Create stimulus and assertions, run simulation, debug test cases on the design models (RTL, power aware RTL, gate level, FPGA, Emulation platform), run regression, collect and analyze code/functional coverage
  • Drive DV closure on diverse IPs and subsystems, ensuring maximum coverage and quality.
  • Familiar with both SoC-level and IP-level verification environments.
  • Guide the team in developing and improving flows for maximum reuse and efficiency.
  • Mentor team members while actively collaborating with design teams for issue resolution and sign-off.
  • Ensure compliance with functional safety/security requirements.

Required Qualifications:


  • Experience: 10+ years in SoC/IP verification with successful tape-outs of multiple SoCs.
  • Technical Skills :
    • Strong expertise in ARM-based microcontrollers and SoC-level verification.
    • Proficiency in SystemVerilog, UVM, and constrained-random verification.
    • Familiarity with EDA tools (Synopsys VCS, Cadence Xcelium, Mentor Questa).
    • Experience with low-power verification (UPF).
    • Gate-level simulations and power-aware simulations.
    • Strong knowledge of assertions (SVA) and functional coverage.
    • Verification of multiple interfaces: SPI, I²C, UART, USB, PCIe, Ethernet, eSPI.
    • Knowledge of Flash memory and security IPs (crypto engines and subsystems) is a plus.
    • Familiarity with common Analog IPs in microcontroller design (ADC, DAC, PLLs).
  • Soft Skills:
    • Comfortable working in a fast-paced environment.
    • Strong team player with excellent communication skills.
  • Education: Bachelors or Master’s in Microelectronics, Electronics, Electrical Engineering


More information about NXP in India...


#LI-2734
لقد تمت ترجمة هذا الإعلان الوظيفي بواسطة الذكاء الاصطناعي وقد يحتوي على بعض الاختلافات أو الأخطاء البسيطة.

لقد تجاوزت الحد الأقصى المسموح به للتنبيهات الوظيفية (15). يرجى حذف أحد التنبيهات الحالية لإضافة تنبيه جديد.
تم إنشاء تنبيه وظيفي لهذا البحث. ستصلك إشعارات فور الإعلان عن وظائف جديدة مطابقة.
هل أنت متأكد أنك تريد سحب طلب التقديم إلى هذه الوظيفة؟

لن يتم النظر في طلبك لهذة الوظيفة، وسيتم إزالته من البريد الوارد الخاص بصاحب العمل.